Ieee Computer Architecture Letters

Ieee Computer Architecture Letters

IEEE计算机体系结构快报

  • 4区 中科院分区
  • Q3 JCR分区

期刊简介

《Ieee Computer Architecture Letters》是由Institute of Electrical and Electronics Engineers Inc.出版社于2002年创办的英文国际期刊(ISSN: 1556-6056,E-ISSN: 1556-6064),该期刊长期致力于计算机:硬件领域的创新研究,主要研究方向为COMPUTER SCIENCE, HARDWARE & ARCHITECTURE。作为SCI、SCIE收录期刊(JCR分区 Q3,中科院 4区),本刊采用OA未开放获取模式(OA占比%),以发表计算机:硬件领域等方向的原创性研究为核心(研究类文章占比100.00%%)。凭借严格的同行评审与高效编辑流程,期刊年载文量精选控制在98篇,确保学术质量与前沿性。成果覆盖Web of ScienceWeb of Science、Scopus等国际权威数据库,为学者提供推动计算机科学领域高水平交流平台。

投稿咨询

投稿提示

Ieee Computer Architecture Letters审稿周期约为>12周,或约稿。该刊近年未被列入国际预警名单,年发文量约98篇,录用竞争适中,主题需确保紧密契合计算机科学前沿。投稿策略提示:避开学术会议旺季投稿以缩短周期,语言建议专业润色提升可读性。

  • 计算机科学 大类学科
  • English 出版语言
  • 是否预警
  • SCI、SCIE 期刊收录
  • 98 发文量

中科院分区

《新锐期刊分区表》(2026年3月发布)

Top期刊 综述期刊 大类学科 小类学科
计算机科学
4区
COMPUTER SCIENCE, HARDWARE & ARCHITECTURE 计算机:硬件
4区

期刊分区表(2025年3月升级版)

Top期刊 综述期刊 大类学科 小类学科
计算机科学
4区
COMPUTER SCIENCE, HARDWARE & ARCHITECTURE 计算机:硬件
4区

期刊分区表(2023年12月升级版)

Top期刊 综述期刊 大类学科 小类学科
计算机科学
3区
COMPUTER SCIENCE, HARDWARE & ARCHITECTURE 计算机:硬件
4区

期刊分区表(2022年12月升级版)

Top期刊 综述期刊 大类学科 小类学科
计算机科学
3区
COMPUTER SCIENCE, HARDWARE & ARCHITECTURE 计算机:硬件
3区

期刊分区表(2021年12月升级版)

Top期刊 综述期刊 大类学科 小类学科
计算机科学
3区
COMPUTER SCIENCE, HARDWARE & ARCHITECTURE 计算机:硬件
3区

JCR分区

2025-2026年最新版

按JCI指标学科分区 收录子集 分区 排名 百分位
学科:COMPUTER SCIENCE, HARDWARE & ARCHITECTURE SCIE Q3 42 / 60

30.8

学科:COMPUTER SCIENCE, HARDWARE & ARCHITECTURE SCIE Q4 50 / 61

18.85

2023-2024年最新版

按JCI指标学科分区 收录子集 分区 排名 百分位
学科:COMPUTER SCIENCE, HARDWARE & ARCHITECTURE SCIE Q4 48 / 59

19.5

学科:COMPUTER SCIENCE, HARDWARE & ARCHITECTURE SCIE Q3 44 / 59

26.27

CiteScore(2026年6月最新版)

CiteScore SJR SNIP CiteScore 排名
CiteScore:2.7 SJR:0.544 SNIP:0.716
学科类别 分区 排名 百分位
大类:Computer Science 小类:Hardware and Architecture Q3 137 / 245

44%

期刊发文

  • VLA-TAGE: A Power-Efficient Branch Predictor With Vector-Loop Awarenes

    Author: Zhang, Chen; Zhang, Shiqing; Zhang, Guangda; Yan, Xiaobo; Zhao, Xia

    Journal: IEEE COMPUTER ARCHITECTURE LETTERS. 2026; Vol. 25, Issue 1, pp. 105-109. DOI: 10.1109/LCA.2026.3669169

  • FlowFlash: An Efficient Dataflow Strategy for FlashAttention Execution on Systolic Array

    Author: Wang, Baosen; Wang, Junjie; Xiao, Siyu; Liu, Y

    Journal: IEEE COMPUTER ARCHITECTURE LETTERS. 2026; Vol. 25, Issue 1, pp. 138-141. DOI: 10.1109/LCA.2026.3678312

  • SAP: Shared-Aware Prefetching for Reducing Inter-Chiplet Data Access Latenc

    Author: Huang, Junpei; Xu, Haobo; Gan, Yiming; Li, Ying; Sun, Wenhao; Wang, Mengdi; Wei, Xiaotong; Min, Feng; Wang, Ying; Han, Yinhe

    Journal: IEEE COMPUTER ARCHITECTURE LETTERS. 2026; Vol. 25, Issue 1, pp. 53-56. DOI: 10.1109/LCA.2026.3658371

  • In-Memory Computing Accelerator for Iterative Linear Algebra Solver

    Author: Liu, Rui; Li, Zerun; Zhang, Xiaoyu; Chen, Xiaoming; Han, Yinhe; Tang, Minghua

    Journal: IEEE COMPUTER ARCHITECTURE LETTERS. 2025; Vol. 24, Issue 1, pp. 161-164. DOI: 10.1109/LCA.2025.3563365

  • Exploring the DIMM PIM Architecture for Accelerating Time Series Analysi

    Author: Shi, Shunchen; Yang, Fan; Li, Zhichun; Li, Xueqi; Sun, Ninghui

    Journal: IEEE COMPUTER ARCHITECTURE LETTERS. 2025; Vol. 24, Issue 1, pp. 169-172. DOI: 10.1109/LCA.2025.3562431

  • Pyramid: Accelerating LLM Inference With Cross-Level Processing-in-Memor

    Author: Yan, Liang; Lu, Xiaoyang; Chen, Xiaoming; Han, Yinhe; Sun, Xian-He

    Journal: IEEE COMPUTER ARCHITECTURE LETTERS. 2025; Vol. 24, Issue 1, pp. 121-124. DOI: 10.1109/LCA.2025.3559738

  • Toward Scalable RDMA Through Resource Prefetchin

    Author: Ma, Zhenlong; Kang, Ning; Yang, Fan; Hong, Chongyang; Xu, Jing; Yuan, Guojun; Zhang, Peiheng; Wang, Zhan; Sun, Ninghui

    Journal: IEEE COMPUTER ARCHITECTURE LETTERS. 2025; Vol. 24, Issue 1, pp. 77-80. DOI: 10.1109/LCA.2025.3534188

  • A DSP-Based Precision-Scalable MAC With Hybrid Dataflow for Arbitrary-Basis-Quantization CNN Accelerato

    Author: Lin, Yuanmiao; Fu, Shansen; Li, Xueming; Yang, Chaoming; Li, Rongfeng; Huang, Hongmin; Hu, Xianghong; Cai, Shuting; Xiong, Xiaoming

    Journal: IEEE COMPUTER ARCHITECTURE LETTERS. 2025; Vol. 24, Issue 1, pp. 65-68. DOI: 10.1109/LCA.2025.3545145